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Consignes de conception FPGA avec Vivado v1.0.0

Utilisez cette ressource pour concevoir un FPGA synchrone en SystemVerilog avec Vivado

Nouveau

  • 402 téléchargements
  • 102 mentions J'aime
  • 180 sauvegardes

Gratuit

Installer avec la CLI

Dans un terminal, depuis le dossier voulu :

npx --yes palatekit@latest install fpga-design-vivado-practices

Sans option, la skill va dans ~/.agents/skills/ ; ajoutez --agent claude-code (ou codex, cursor…) pour viser un agent.

Première fois : connectez la CLI avec

npx --yes palatekit@latest login

L'agent organise la conception en modules, privilégie un seul domaine d'horloge et une réinitialisation synchrone, traite les contraintes de timing, la conformité AXI, les traversées de domaines d'horloge et la réduction de latence, et propose des méthodes de débogage en simulation. Vous obtenez une architecture RTL claire.

Choisie surtout par

Mise à jour le 2 novembre 2026

Carte de la skill « Consignes de conception FPGA avec Vivado »

Caractéristiques

Guides d'installation
Génère avec
Le modèle de votre agent
Licence
Apache-2.0

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Ce que vous obtenez

  • SKILL.md : architecture modulaire et conception synchrone
  • SKILL.md : contraintes de timing, AXI et DMA

Pour qui

  • Vous concevez un bloc de traitement de données sur FPGA
  • Votre design échoue à la fermeture du timing dans Vivado

Pas pour qui

    Étiquettes

    • FPGA
    • Vivado
    • SystemVerilog
    • AXI

    À propos

    Vous dites

    « Structure ce module SystemVerilog de traitement vidéo et vérifie les traversées de domaines d'horloge. »

    Carte de la skill « Consignes de conception FPGA avec Vivado »

    Skill publiée par mindrally sous licence Apache-2.0. Fichiers livrés dans leur version d'origine, en anglais.

    Voir plus

    Comment l'utiliser

    1. Installez la skill dans le dossier de skills de votre agent
    2. Demandez à votre agent de concevoir un FPGA synchrone en SystemVerilog avec Vivado
    3. Relisez et ajustez le résultat

    Aperçu du contenu

    Fichiers

    • LICENSE11,3 Ko
    • NOTICE-PALATEKIT.md0,5 Ko
    • SKILL.md2,8 Ko

    Origine et licence

    Référencée sans modification

    Auteur
    mindrally
    Source
    github.com/mindrally/skills/tree/7682ca77710e0971eab4e0ae5dddfa281aea0ba5/fpga
    Licence
    Apache-2.0

    Notice

    « fpga » (mindrally, Apache-2.0) livré dans sa version d'origine : fiche en français et en anglais par PalateKit.

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